Beckhoff EtherCAT IP Core for Xilinx FPGAs v2.04e manuels

Manuels d'utilisation et guides de l'utilisateur pour Équipement Beckhoff EtherCAT IP Core for Xilinx FPGAs v2.04e.
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Beckhoff EtherCAT IP Core for Xilinx FPGAs v2.04e Manuel d'utilisateur (126 pages)

marque: Beckhoff | Catégorie: Équipement | Taille: 1.98 MB |

Table des matières

® FPGAs

FIGURES

1 Overview

EtherCAT IP Core

Table 4: Release notes

Figure 3: Design flow

2 Features and Registers

Features and Registers

Table 8: Legend

Table 10: Legend

3 IP Core Installation

4 IP Core Usage

Figure 7: EDK – Overview

IP Core Usage

5 IP Core Configuration

Figure 13: Product ID tab

09) is available if checked

6 Example Designs

7 FPGA Resource Consumption

32 bit wide

8 IP Core Signals

Table 19: SII EEPROM Signals

Table 20: LED Signals

PHY Management

Table 23: PHY Interface MII

Table 24: PHY Interface RMII

Table 26: Digital I/O PDI

Table 27: SPI PDI

Table 28: 8/16 Bit µC PDI

Table 29: 8 Bit µC PDI

Table 30: 16 Bit µC PDI

Table 31: PLB PDI

Table 32: OPB PDI

PHY_OFFSET_VEC[4:0]

Ethernet PHY

RX_D[3:0]

MII_RX_DATA[3:0]

MII_TX_DATA[3:0]

CLK_IN CLK25

MII_TX_SHIFT[1:0]

10 PDI Description

Digital output pins

Figure 39: OUT_ENA timing

Table 43: SPI signals

Table 44: Address modes

SPI_DO (MISO)

SPI_DI (MOSI)

SPI_CLK*

SPI mode 1/3 SPI mode 0/2

100

PDI Description

101

16 bit µController, async

106

EtherCAT device

106

8 bit µController, async

107

(with preceding write access)

110

Output event time

120

EtherCAT

121

PROM_DATA

121

PROM_CLK

121

PROM_SIZE

121

Table 63: AC Characteristics

122

Table 64: Forwarding Delays

122

14 Synthesis Constraints

123

15 Appendix

126

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