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95
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97
98
ESC specific registers (0x0E00:0x
0EFF)
Slave Controller
–
Register Des
cription
II-
79
3.50.4
ESC
20
Table
134
: Register FPGA Update (0x0E00:0x0EFF)
ESC20
ET1100
ET1200
IP Core
Bit
Description
ECAT
PDI
Reset Value
FPGA Update (ESC2
0 and TwinCAT
only)
1
2
...
86
87
88
89
90
91
92
93
94
95
96
97
98
1 Address Space Overview
13
2 ESC Register Availability
19
3 Register description
22
ET1200: 11
29
IP Core
30
DiffCounterSpeed
76
Deviation
76
5 Appendix
98
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